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FORMATION : RISC-V

Du 20 au 21 juin Courbevoie (92)

(Session initialement programmée les 14 et 15 mars)

Cette formation a pour but de comprendre l’architecture RISC-V et l’implémentation du cœur SiFive E31. Ainsi les mécanismes sophistiqués tels que la protection de la mémoire, la gestion des interruptions globales et externes seront abordés. La mise en œuvre de l’architecture RISC-V sera réalisée en utilisant l’environnement de développement de Microsemi via les outils de développements Libero SoC PolarFire et d’intégration du logiciel.

Inscription en ligne

Programme :

Introduction to RISC-V ISA Modules
• RV32-I/E and RV64-I/E Base Integer Instruction SET
• Integer Multiplication and division
• Atomic Instructions
• Floating Point precision(Single-double-Quad)
• Compressed Instructions
• SIMD instructions
• User-Level interrupts

Privileged Architecture
• Control and Status Registers (CSRs)
• Machine-Level ISA
• Control and Status Registers (CSRs)
• Machine-Level ISA
• Supervisor-Level ISA
• RISC-V Interrupts

SiFive E31 Core and Interfaces
• Core Complex Interfaces
• Memory Map
• Interrupts
• Platform-Level Interrupts Controller
• Core Local Interrupter (CLINT)
• Physical Memory Protection

Libero SoC PolarFire :
• Microsemi FPGA & SoC overview
• Libero SoC PolarFire overview
• Create and Design
• Constraint management
• TestBench and Simulations
• Program and Debug
• Microsemi tool’s

Demo : Create a New Project
Demo : TestBench, Simulation
Demo : Synthesize the design
Demo : Place & Route

Programming the RISC-V Core
• SoftConsole
o Overview and Firmware drivers
o Supported platforms
o Packages
o Related Microsemi Tools and resources
o RISC-V Hardware Abstraction Layer (HAL)
• SmartDebug
o Introduction and SmartDebug User Interface
o Using SmartDebug
o Create Standalone SmartDebug Project
o Programming Connectivity and Interface
• RISC-V project
• Debugging and Troubleshooting

Demo : Building a RISC-V Processor subsystem
Demo : Creating a RISC-V SoftConsole Project
Demo : Managing

Lieu de l’événement :

21, rue Pierre Curie
92400 COURBEVOIE
FRANCE

Transport en commun :

M3 (Porte de Champerret) + Bus164 (Europe) + 3min
RERA (La defense) + Bus178 (République Colombes) + 3min

Participation aux frais :

- Prix préférentiel pour les PME adhérentes CAP’TRONIC : 800 € HT
- Pour les grandes entreprises et les PME qui ne souhaitent pas adhérer : 1100 € HT.

Si vous êtes une PME non adhérente :
Vous pouvez adhérer à l’association JESSICA France. Pour cela contacter Florence CAGNARD
Modalités d’adhésion

Remarque : Jessica France est titulaire d’un numéro d’agrément de formation continue et est référencé DATADOCK depuis le 1er juillet 2017. La prise en charge de cette formation est donc possible par les Organismes Paritaires Collecteurs Agréés (OPCA) mais attention, l’étude de votre dossier peut prendre plusieurs semaines, renseignez-vous dès maintenant et inscrivez-vous au plus tôt.

Contact :

Christophe BRICOUT - 09 52 73 77 88

Contact Inscriptions :
Anne-Laure ARIAS - 04 38 78 29 06

FORMATION : RISC-V - 20 au 21 juin 2019 - Courbevoie (92)



Les informations recueillies sur ce formulaire sont enregistrées dans un fichier informatisé par JESSICA France à des fins de communication via emailing. Elles sont conservées jusqu’à votre demande de désinscription et sont destinées aux équipes de JESSICA France localisées en France. Conformément à la loi « informatique et libertés », vous pouvez exercer votre droit d’accès aux données vous concernant et les faire rectifier en contactant